4 つのフリップフロップで構成されるリング カウンタは、最大でもいくつかの有効な状態を持ちます。

4 つのフリップフロップで構成されるリング カウンタは最大 16 状態を持ち、リング カウンタ (D0=Qn(k-1)) はシフト レジスタと特定のフィードバック回路で構成され、合計 16 状態になります。有効なカウント状態は 4 つしかなく、k 個の D フリップフロップには K 個のカウント状態がありますが、ツイスト リング カウンタの場合、リングの 2 倍である 2K 個のカウント状態があります。

#このチュートリアルの動作環境: Windows 10 システム、DELL G3 コンピューター。

4 つのフリップフロップで構成されるリング カウンタには、最大でもいくつかの有効な状態があります。

リング カウンタ (つまり、D0=Qn(k-1)) には、合計 16 の状態があります。 、有効なカウント状態は 4 つだけで、k 個の D フリップフロップには K 個のカウント状態がありますが、ツイスト リング カウンタの場合は、リングの 2 倍である 2K 個のカウント状態があります。

リング カウンタは、シフト レジスタと特定のフィードバック回路で構成されています。シフト レジスタは、リング カウンタの一般的なブロック図を形成するために使用されます。シフト レジスタと結合されたフィードバック ロジック回路で構成されています。閉じたループ。

フィードバック回路の出力は、シフト レジスタのシリアル入力に接続されます。フィードバック回路の入力は、シフト レジスタのタイプに応じて、シフト レジスタのシリアル出力または何らかのトリガーに接続できます。カウンタ、デバイスの出力端子。

拡張情報

リング カウンタは、シフト レジスタと特定のフィードバック回路で構成されており、シフト レジスタはリング カウンタの一般的なブロック図を形成するために使用されます。シフトレジスタは帰還論理回路を組み合わせた閉ループで構成され、帰還回路の出力はシフトレジスタのシリアル入力端子に接続され、帰還回路の入力端子は接続可能シフトレジスタのカウンタの種類に応じてシフトレジスタのシリアル入力端子に接続し、出力またはフリップフロップの出力を出力します。

動作原理の紹介

図 23-5-2 は 4 ビットのリング カウンタで、これは最も低いシフトです。レジスタ 1 ビットシリアル出力端子 Q1 を最上位シリアル入力端子 (D フリップフロップのデータ端子) にフィードバックする パルス列分配機能 (分配器) を実現するためにリングカウンタがよく使用されます。 ）。レジスタの初期状態が [Q4Q3Q2Q1]=1000 であると仮定すると、シフト パルスの作用により、その状態は表 23-11 の順序で変換されます。

3 番目のシフトパルスが来ると Q1=1 となり、D4 入力端子にフィードバックされますが、4 番目のシフトパルスの作用で Q4=1 となり初期状態に戻ります。表 23-11 の各状態は、シフト パルスの作用下で 4 ビット シフト レジスタを繰り返し循環します。

上記の説明から、リングカウントのカウント長は N=n であることがわかります。バイナリカウンタと比較すると、使用されない状態が 2^n-n 個あり、有効に使用される状態が少なくなります。

関連知識の詳細については、

FAQ 列をご覧ください。

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