直接用 _mm256_mul_ps 做矩阵乘会变慢，因为avx指令不解决内存瓶颈；未分块、未对齐、未预取、未转置导致缓存命中率低和数据供给不足，无法让向量单元持续满负荷运行。
为什么直接用 _mm256_mul_ps 做矩阵乘会变慢
因为 AVX 指令本身不负责数据搬运，而矩阵乘的瓶颈常在内存带宽和 cache 命中率。如果只是把标量循环替换成 _mm256_mul_ps + _mm256_add_ps，但没做分块（blocking）、没对齐内存、没预取，实际性能可能比优化过的标量版本还差。
关键不是“用了 AVX”，而是“让 AVX 持续吃饱”：每条指令都得有数据可算，且避免 bank conflict / TLB miss / cache line split。
- 确保输入矩阵按 32 字节对齐（
aligned_alloc(32, size)或std::aligned_alloc），否则_mm256_load_ps可能触发 #GP 异常或降速 - 避免跨 cache line 加载——比如 float 数组起始地址是 0x1004，加载 8 个 float（32 字节）就会横跨两个 cache line
- 别在内层循环反复调用
_mm256_store_ps到未写分配（write-allocate）缓存区；考虑先 accumulate 到寄存器，再批量写回
如何组织循环顺序才能适配 AVX 的 8-float 并行度
标准三重循环 i-j-k 中，k 维最内层适合向量化，但原始顺序下 A[i][k] 是行主序连续，B[k][j] 是列主序不连续 → 导致 B 的每次 k 迭代都要随机访存。
解决办法是：对 B 预转置一个 tile（比如 8×8），再与 A 的 8×8 tile 做 micro-kernel 计算。这样 A 和转置后的 B 都是连续加载，一次 _mm256_load_ps 就能取满 8 个 float。
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- 外层用
i和j做 64×64 分块（对应 L2 cache 容量），中间层对 B 的列块做 8 行预转置（transpose_8x8） - 最内层用 8×8 micro-kernel：A 的一行 × B 的一列 → 8 次
_mm256_mul_ps+ 累加到 8 个__m256寄存器 - 使用
_mm256_hadd_ps或手动 shuffle + add 来水平求和 8 个结果，再存回 C
AVX2 和 AVX-512 在矩阵乘中的实际差异在哪
AVX2 的 _mm256_dp_ps 不支持浮点点积，所以 8×8 kernel 必须手写 8 轮 multiply-accumulate；而 AVX-512 的 _mm512_dpbf16_ps（BF16）或 _mm512_fmadd_ps 能单指令完成 16×16 的 FMA，但代价是：寄存器压力翻倍、频率可能降频、部分 CPU 上 512-bit 指令吞吐只有 256-bit 的一半。
- 在 Intel Ice Lake 或 Sapphire Rapids 上，启用 AVX-512 后若未关闭 turbo boost，实测 double-precision 乘法吞吐未必提升，因功耗墙触发降频
- AVX2 更稳：所有主流 x86-64 CPU（包括 AMD Zen2+）都支持，且 256-bit 指令在大多数负载下能维持基础频率
- 若目标平台不确定，宁可用 AVX2 + OpenMP 多线程，也别强上 AVX-512 ——
__builtin_cpu_supports("avx512f")检查后仍要 fallback
并行时最容易被忽略的 cache 冲突问题
多个线程同时写同一 cache line 的不同字节（false sharing），会导致 core 间 cache line 持续无效化。C 矩阵若按行划分给线程，而每行长度不是 cache line 对齐（64 字节 = 16 个 float），就极易踩坑。
- 为每个线程分配独立的 C 子块，并确保子块起始地址是 64 字节对齐，且宽度（列数）向上补齐到 16 的倍数
- 避免用全局累加变量；改用线程局部
__m256 acc[8]，最后再合并到 C - 编译时加
-march=native -O3 -funroll-loops，但注意 GCC 12+ 对#pragma omp parallel for schedule(static)默认不 pad 循环边界，需手动处理余数
真正难的不是写出 AVX 指令，而是让它们在真实 cache 层次、内存控制器、多核一致性协议下不互相拖后腿。
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